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有源晶振使用方法

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樓主

ID:1149168 發表于 2025-8-22 11:38 | 只看該作者回帖獎勵

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有源晶振EMC標準設計電路，如果對EMC要求不高，可以去掉L1磁珠及C1負載電容，只保留電源輸入端的去耦電容，取0.1uf即可，輸出端保留輸出電阻，約10Ω~27Ω。
有源晶振的典型電路說明如下：
1、電源端磁珠L1與電容C2、C3構成LC濾波電路。
2、關于輸出端串聯的電阻的作用，串電阻是為了減小反射波，避免反射波疊加引起過沖。有時，不同批次的板子特性不一樣，留個電阻位置便于調整板子狀態到最佳。如無必要串電阻，就用0Ω電阻連接。

其中Tri-state為三態控制引腳，
連接到VCC/VDD：三態引腳可以直接連接到電源電壓（如3.3V），以確保晶振輸出頻率的穩定性。
懸空處理：如果不需要三態功能，可以選擇將三態引腳懸空。
控制輸出：在三態功能下，邏輯高時輸出支持，邏輯低時輸出禁用，允許輸出引腳處于高阻抗狀態。
電源濾波：在連接電源時，建議使用電容和電感構成的PI型濾波網絡，以確保信號質量。
出于阻抗匹配（減小回波干擾及導致的信號過沖。只要阻抗不匹配，都會產生信號反射，即回波）的考慮，有源晶體的輸出阻抗通常都很低，一般在幾百歐以下，而信號源的輸入端在芯片內部結構上通常是運放的輸入端，由芯片的內部電路與外部的無源石英晶體構成諧振電路(使用有源晶體后就不需要這個晶體了)，這個運放的輸出阻抗都在兆歐以上。一般這個輸出電阻可以串27Ω左右。

有源晶振的具體作用如下：
(1)可以減少諧波，有源晶體輸出的是方波，這將引起諧波干擾，尤其是阻抗嚴重不匹配的情況下，加上電阻后，該電阻將與輸入電容構成RC積分平滑電路，將方波轉換為近似正弦波，雖然信號的完整性受到一定影響，但由于該信號還要經過后級放大、整形后才作為時鐘信號，因此，性能并不受影響，該電阻的大小需要根據輸入端的阻抗、輸入等效電容，有源晶體的輸出阻抗等因素選擇。

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